泉源：iPhone 18 Pro Max设置曝光作者： 王惟伟：

从智能体到韬定律，，集微EDAIP工业软件论坛解码AI时代EDA破局之道

5月27-29日，，第十届集微大会在上海张江科学礼堂盛大举行。。作为大会焦点议程，，集微EDA IP工业软件论坛于29日重磅启幕，，汇聚全球EDA、IP、工业软件领域领军企业与顶尖专家，，紧扣“AI 重构未来、生态协同致远”主题，，聚焦智能体AI、先进封装、制造良率、边沿算力、量子EDA等工业焦点，，共探手艺突破路径、共商生态协同方略，，为中国半导体高质量生长注入焦点动能。。

恰逢华为韬（τ）定律（τ=RC，，时间常数）引刊行业热议，，后摩尔时代芯片设计正从“缩尺寸”转向“缩时间”，，互连RC延迟成为决议性能、功耗与时序收敛的焦点变量，，为国产EDA突破手艺瓶颈、修建差别化竞争力指明晰全新偏向。。从智能体AI重塑设计流程，，到制造端DTCO与良率治理智能化，，再到高速互联与边沿NPU修建算力底座，，事实上中国EDA/IP工业链正以契合韬定律所指出的系统级协同立异为引擎，，加速迈向自主可控与全球竞争的新阶段。。

本次论坛大咖云集、阵容壮盛，，不但有新思科技、Ceva等国际企业带来前沿视野，，更集结华大九天、合见工软、东方晶源、安谋科技、广立微、全芯智造、牛芯半导体、芯和半导体、行芯科技、上海立芯、硅芯科技等海内头部企业，，以及香港中文大学、FIA大学等高校与科研机构专家，，全方位泛起AI时代EDA/IP领域的手艺刷新与工业实践。。

AI重塑设计范式，，智能体与全流程工具重构芯片开发新生态

AI手艺正深度渗透芯片设计全流程，，推动设计效率、生产力与立异界线跨越式升级，，从辅助工具演变为芯片设计的“智能共驾”，，智能体（Agentic AI）使能全流程自主决议与协同优化。。从RTL天生到物理实现，，AI驱动的设计范式将生产力提升一个数目级，，大幅缩短上市周期。。

论坛在华芯巨数首席执行官李晓慧支持下开启，，多家企业展示了AI与EDA深度融合的最新效果。。

主持人华芯巨数首席执行官李晓慧

新思科技高级资深应用工程师李隆系统叙述了智能体AI（Agentic AI）怎样应对芯片设计重漂后激增、周期缩短与人才欠缺三重挑战。。其AgentEngineer框架将AI能力从L1辅助演进至L5决议，，笼罩架构规范、RTL天生、验证、调试到物理实现全流程，，实现10倍生产力提升与50%上市时间缩短，，推动芯片开发从古板迭代向一连优化与立异驱动转型。。

新思科技高级资深应用工程师李隆

华大九天高级总监余涵则聚焦量子科技战略赛道，，依托海内唯一意会射频微波全流程的Aether MW平台，，打造了面向中小规模量子芯片的Q-EDA全流程系统，，已笼罩目今QDA工具链70%的需求，，并连系AI驱动的自动结构布线与2.5D/3DIC解决方案，，为百万比特级通用量子盘算机涤讪设计基础。。

华大九天高级总监余涵

最近华为提出的“韬（τ）定律”强势刷屏，，行芯科技市场销售高级总监任旭围绕“韬（τ）定律”（τ=RC）提出τ-Aware Signoff理念，，将寄生参数提取、电迁徙压降与光学相近修正视为“时间、能量、几何”三维保真度的平行进化。。针对3DIC LogicFolding带来的跨芯片寄生耦合、热效应、供电噪声、多物理场交互等严肃挑战，，行芯推出GloryEX、GloryGrid等一站式签核工具，，已乐成助力海内首颗纯国产先进工艺3DIC芯片流片。。

行芯科技市场销售高级总监任旭

香港中文大学余备教授从学术视角剖析先进工艺下EDA盘算资源面临的精度、规模、速率三重压力。。他以概伦电子NanoSpice Pro X的万核并行SRAM K库仿真、DREAMPlace结构深度学习的40倍GPU加速、开源OpenILT的CUDA漫衍式盘算光刻为例，，论证了CPU+GPU/NPU异构并行、云弹性与AI智能调理是破解盘算瓶颈的要害路径，，推动EDA与高性能盘算双向赋能。。

香港中文大学余备教授

硅芯科技高级产品研发工程师吴明辉指出后摩尔时代先进制程面临本钱指数级增添、良率断崖式下跌、算力增添无法知足需求的三重；；；；；；，，2.5D/3D Chiplet堆叠手艺成为突破本钱、性能与外洋封锁困局的最优解，，但也带来了异质异构集成、多物理场耦合、多芯片测试验证等全新挑战，，古板EDA工具已无法适配。。公司推出3Sheng Integration Platform新一代先进封装EDA+平台，，笼罩架构设计、物理实现、多物理场仿真、多芯片DFT与验证全流程，，已在超异构盘算、硅光AI Chiplet等项目中实现落地。。

硅芯科技高级产品研发工程师吴明辉

制造EDA与良率治理迈向智能化，，DTCO驱动工艺极限突破

制造端EDA是国产化最薄弱的环节，，也是先进工艺良率爬坡的“生命线”。。通过AI赋能盘算光刻、器件建模与缺陷剖析，，设计与工艺协同优化（DTCO）正成为突破物理极限、提升国产芯片竞争力的焦点路径。。

东方晶源副总裁丁明指出，，先进节点中Patterning相关的辖档图率损失已凌驾随机缺陷，，古板人工+规则模式难以为继。。公司提出HPO设计制造协同优化理念，，构建全球唯一的软硬件连系产品矩阵，，包括PanGen Total Mask系列盘算光刻工具（DMC/PHD/vPWQ/RUI）、多款海内首台12英寸量检测装备及YieldBook AI良率治理平台，，实现从设计到刻蚀的全流程坏点提前发明与修复，，DMC的AI轮廓展望精度超99%且速率为古板OPC的100倍。。

东方晶源副总裁丁明

广立微手艺市场总监张克非强调登纳德缩放定律失效后，，DTCO成为先进工艺下提升PPA的焦点手段，，对海内芯片设计公司尤为要害。。公司提供OnChipTSK、CAPMM、RO IP等高效测试结构，，以及笼罩CMP建模、图形检测、智能填充、AI风险展望的DFM产品矩阵，，连系DE-YMS/YAD良率剖析与诊断平台，，将根因定位时间缩短80%，，在海内逻辑工艺良率提升市场市占率达95%。。

广立微手艺市场总监张克非

全芯智造副总裁孟晓东指出制造EDA是国产化率缺乏10%的最稀缺环节。。公司作为海内唯一笼罩制造EDA全流程的企业，，依托自建算力集群与半导体数据湖，，打造笔直大模子中台与LithoChat AI Agent，，在盘算光刻、器件建模、良率管控、DTCO四大场景实现对标国际厂商的全栈替换，，已支持先进工艺流片，，并妄想适配国产EUV与新质料装备。。

全芯智造副总裁孟晓东

上海立芯资深副总杨晓剑指出国产先进工艺制程物理实现方面面临着工艺波动（PVT）、多重曝光（DPT/MPT）、良率和可制造性（DFM）以及寄生效应电迁徙（EM）越发显著等多重挑战。。公司大规模全流程数字设计平台LeDI，，整合LeSyn物理综合、LePlan智能布图妄想与LeAPR自动结构布线三大焦点工具，，高效处理万万级实例设计，，通过PDK-DTCO全流程协同与机械学习优化，，实现对先进工艺下PVT、多重曝光、DFM等挑战的系统性突破。。

上海立芯资深副总杨晓剑

IP、NPU与高速互联筑底AI生态，，“运力”与算力协同进化

AI基础设施正从单芯片算力竞争转向机架级、集群级系统协同，，互连性能这一“运力”成为释放算力的要害瓶颈。。国产高速互联IP、专用NPU与系统级仿真平台配合修建起自主AI生态的坚实底座。。

面向AI基础设施从单芯片向机架级、集群级系统扩展的趋势，，IP、NPU及高速互联手艺的立异成为论坛又一要害议题。。

FIA大学教授、MultiCortex首创人、国际剖析师Alessandro(Cabelo) de Oliveira Faria指出目今软硬件适配不对理、算力能耗高、能源与水资源消耗压力大，，需寻找新的手艺缺口。。他从软硬件接口优化角度，，详解SIMD从MMX到AVX-512/Intel AMX的演进，，AMX可实现20倍性能提升，，并通过OpenCV指令设置、CUDA算力匹配划分带来1500%、3300%的性能加速，，同时展示oneAPI/SYCL实现跨厂商架构兼容及联邦推理等前沿实践。。

FIA大学教授、MultiCortex首创人、国际剖析师Alessandro(Cabelo)deOliveira Faria

随着AI已从感知、天生阶段进入智能体时代，，智能体事情负载泛起云边协同态势，，边端侧LLM推理占比降至25%，，使命编排、向量检索与多模态处理占比显著提升，，2025年NPU已占有边沿推理芯片超60%的市场份额，，同时边端侧NPU面临精度与效率博弈、内存墙与带宽瓶颈、异构盘算多核协同调理三大焦点挑战。。

安谋科技高级产品司理叶斌聚焦边端侧大模子“下沉”趋势，，先容公司专为大模子而生的周易NPU X3，，单Cluster算力达8-160 TFLOPS，，支持INT4/FP4至FP16全精度，，配备硬件级多使命调理器与Compass AI软件平台，，R2版本W4A8/W4A16算力最高提升2倍，，已在智能座舱、边沿AI服务器等场景落地。。

安谋科技高级产品司理叶斌

Ceva FAE Phillipe Guo详细先容了公司的NeuPro-Nano NPU，，专为MCU边沿AI设计，，接纳单核可编程架构内置DSP，，支持INT4/8/16及Transformer，，功耗低于1W、算力笼罩10 GOPS至5 TOPS，，配合NeuPro Studio SDK与Model Zoo，，可快速安排音频、语音、视觉等嵌入式AI应用。。

Ceva FAE Phillipe Guo

牛芯半导体市场副总司理邬红缨直击“运力墙”瓶颈——算力年增1.5倍而内存/互联带宽仅增0.8/0.7倍，，严重制约AI性能释放。。中国作为全球最大数据市场，，高速互联手艺以来入口，，自主可控需求迫在眉睫。。公司作为少数同时提供高速互联IP授权与芯片定制服务的企业，，拥有DDR、SerDes、D2D等10大类百余种IP，，率先在国产工艺突破112Gbps，，并结构224Gbps PAM、HBM3/4、UCIe 32G等更高速手艺。。

牛芯半导体市场副总司理邬红缨

目今AI基础设施正从单芯片算力竞争转向机架级系统协同，，超节点互联成为国产芯片性能突破的要害，，同时也面临互联协议繁杂、组网验证难度大等痛点。。

芯和半导体市场副总裁仓巍指出AI算力需求增久远超摩尔定律供应，，破局需通过Chiplet异构集成与超节点辖档徒级路径，，但带来千安级供电、兆瓦级散热及光-电-热-磁-应力多物理场协同挑战，，推动EDA从芯片级DTCO迈向系统级STCO协同设计。。芯和推出从芯片到系统的全栈EDA平台，，笼罩电/光互连建模、高速链路剖析、电源完整性与微流道散热优化，，并宣布XAI多智能体系统，，助力工业链完成从单芯片到超节点的系统级协同设计与性能跃升，，构建面向AI工厂的新一代EDA范式。。

芯和半导体市场副总裁仓巍

合见工软营业与相助拓展总监牛锋则聚焦硬件仿真器在AI大算力芯片中的要害作用。。面临超节点互联协议繁杂、组网验证难度高等痛点，，合见工软推出UVHS-2、UVHP全场景验证平台，，连系自研SUE、ETH-X等IP+VIP方案，，已联合中国信通院、腾讯建设ODCC AI网络联合实验室并宣布测试报告，，并与燧原科技相助开发智算多卡组网方案，，有用应对互联互通重大、验证难度高、迭代快等难题，，助力国产AI大算力芯片缩短研发周期、突破互联壁垒。。

合见工软营业与相助拓展总监牛锋

从接口优化到智能设计，，从先进封装到制造良率，，从高速互联到量子EDA，，论坛周全展现了中国EDA/IP工业链的立异实力与协同生态。；；；；；；岢龅摹拌海é樱┒伞痹谝到缫⑵毡槿纫，，也标记着后摩尔时代芯片设计正从“缩尺寸”转向“缩时间”，，互连RC延迟成为决议性能与能效的焦点变量——这一趋势与本次论坛所探讨的3DIC签核、时序优化、多物理场仿真等偏向高度契合，，也为国产EDA在先进工艺下的手艺突破提供了全新理论支点。。

与会企业与专家一致以为，，AI时代的到来正从基础上重塑EDA/IP的竞争逻辑——从单点工具优化转向系统级协同设计，，从人工履历驱动转向智能体自主决议。。在国产替换与AI芯片重漂后攀升的双重浪潮下，，中国EDA/IP工业正迎来前所未有的战略机缘期。。唯有坚持手艺自主、生态协同、场景落地，，才华一连突破手艺封锁与工业瓶颈，，配合打造自主可控、清静高效、引领全球的半导体工业新生态。。